Datasheets
EP3C5E144C8N SR5U2

EP3C5E144C8N SR5U2

Intel

Descrição:

FPGA Cyclone® III Family 5136 Cells 402MHz 65nm Technology 1.2V 144-Pin EQFP EP Tray

Atualizado:16-DEC-2024

Ver mais Field Programmable Gate Arrays - FPGAs por Intel
Especificações da Peça

Visão geral

Familiarize-se com as informações gerais, propriedades e características fundamentais do componente, juntamente com sua conformidade com as normas e regulamentos da indústria.

Ciclo de VidaPremium
Código CAGE do Fornecedor4BA62
8542310060
SCHEDULE B8542310060
Caminho da Categoria
Semiconductor > Programmable Devices > Programmable Logic Devices > Field Programmable Gate Arrays - FPGAs

Ficha técnica

Obtenha uma compreensão abrangente do componente eletrônico baixando sua folha de dados. Este documento em PDF inclui todos os detalhes necessários, como visão geral do produto, características, especificações, classificações, diagramas, aplicações e muito mais.

Ficha de dados do fornecedor
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Pré-visualização da folha de dados

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Paramétrico

As informações paramétricas exibem características vitais e métricas de desempenho do componente, o que ajuda os engenheiros e gerentes da cadeia de suprimentos a comparar e escolher o componente eletrônico mais adequado para suas aplicações e necessidades.

linha de produto
Maximum Distributed RAM Bits
I/O Voltage
Shift Registers
Number of Global Clocks
Copy Protection
Typical Supply Current
Maximum Power Dissipation
Temperature Flag
Supplier Temperature Grade
In-System Programmability
Digital Control Impedance
Number of I/O Banks
Mega Multiply Accumulates per second
Tolerant Configuration Interface Voltage
Minimum Storage Temperature
Number of Inter Dielectric Layers
Maximum Storage Temperature
Maximum DSP Block Frequency
Maximum MLAB Capacity
Device PCIe Hard IP Blocks
Number of Regional Clocks
Maximum LVDS Data Rate
Maximum Differential I/O Pairs
Maximum I/O Performance
Typical Power Consumption
Maximum Quiescent Current
JTAG Support
Maximum Supply Current
Maximum Internal Frequency
Reprogrammability Support
Tradename
Device Logic Gates
Device Logic Units
Family Name
Maximum Number of User I/Os
Number of Registers
RAM Bits
Device Logic Cells
Number of Look-up Table Input
Device System Gates
Ethernet MACs
Minimum Operating Supply Voltage
Number of Multipliers
Typical Operating Supply Voltage
Processor Blocks
Maximum Operating Supply Voltage
Transceiver Blocks
Transceiver Speed
Program Memory Type
Dedicated DSP
PCI Blocks
Device Number of DLLs/PLLs
Total Number of Block RAM
Maximum Propagation Delay Time
Giga Multiply Accumulates per Second
Maximum Number of SERDES Channels
Speed Grade
Differential I/O Standards Supported
Single-Ended I/O Standards Supported
External Memory Interface
Supported IP Core
Supported IP Core Manufacture
Minimum Operating Temperature
Maximum Operating Temperature
Programmability
Process Technology

Referências cruzadas

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