Datasheets
GW2AR-LV18QN88PC7

GW2AR-LV18QN88PC7

Gowin Semiconductor Corporation

Beschreibung:

FPGA GW2AR Family 20736 Cells 55nm Technology 1V

Einführungsdatum:

May 28, 2021

Aktualisiert:+90 Tage

Mehr anzeigen Field Programmable Gate Arrays - FPGAs von Gowin Semiconductor Corporation
Teilespezifikationen

Überblick

Machen Sie sich mit den grundlegenden allgemeinen Informationen, Eigenschaften und Merkmalen des Bauteils vertraut, sowie mit seiner Einhaltung von Branchenstandards und Vorschriften.

LebenszyklusPremium
EU-RoHS Yes
RoHS-Version2011/65/EU, 2015/863
Lieferanten-Cage-CodeCage Code Not Available
8542310060
SCHEDULEB8542310060
Kategoriepfad
Semiconductor > Programmable Devices > Programmable Logic Devices > Field Programmable Gate Arrays - FPGAs

Datenblatt

Erhalten Sie ein umfassendes Verständnis des elektronischen Bauteils, indem Sie das Datenblatt herunterladen. Dieses PDF-Dokument enthält alle erforderlichen Details wie Produktübersicht, Merkmale, Spezifikationen, Bewertungen, Diagramme, Anwendungen und mehr.

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Parametrisch

Die parametrischen Informationen zeigen wichtige Merkmale und Leistungskennzahlen des Bauteils auf, was Ingenieuren und Supply-Chain-Managern hilft, das am besten geeignete elektronische Bauteil für ihre Anwendungen und Bedürfnisse zu vergleichen und auszuwählen.

productlijn
Maximum Distributed RAM Bits
I/O Voltage
Shift Registers
Number of Global Clocks
Copy Protection
Typical Supply Current
Maximum Power Dissipation
Temperature Flag
Supplier Temperature Grade
In-System Programmability
Digital Control Impedance
Number of I/O Banks
Mega Multiply Accumulates per second
Tolerant Configuration Interface Voltage
Minimum Storage Temperature
Number of Inter Dielectric Layers
Maximum Storage Temperature
Maximum DSP Block Frequency
Maximum MLAB Capacity
Device PCIe Hard IP Blocks
Number of Regional Clocks
Maximum LVDS Data Rate
Maximum Differential I/O Pairs
Maximum I/O Performance
Typical Power Consumption
Maximum Quiescent Current
JTAG Support
Maximum Supply Current
Maximum Internal Frequency
Reprogrammability Support
Tradename
Device Logic Gates
Device Logic Units
Family Name
Maximum Number of User I/Os
Number of Registers
RAM Bits
Device Logic Cells
Number of Look-up Table Input
Device System Gates
Ethernet MACs
Minimum Operating Supply Voltage
Number of Multipliers
Typical Operating Supply Voltage
Processor Blocks
Maximum Operating Supply Voltage
Transceiver Blocks
Transceiver Speed
Program Memory Type
Dedicated DSP
PCI Blocks
Device Number of DLLs/PLLs
Total Number of Block RAM
Maximum Propagation Delay Time
Giga Multiply Accumulates per Second
Maximum Number of SERDES Channels
Speed Grade
Differential I/O Standards Supported
Single-Ended I/O Standards Supported
External Memory Interface
Supported IP Core
Supported IP Core Manufacture
Minimum Operating Temperature
Maximum Operating Temperature
Programmability
Process Technology

Überschneidungen

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