EPM240GF100I5
Intel描述: | CPLD MAX® II Family 192 Macro Cells 201.1MHz 0.18um Technology 1.8V 100-Pin FBGA |
推出日期: | Mar 1, 2004 |
更新:15-NOV-2024 | |
在线版本:https://www.datasheets.com/zh-cn/part-details/epm240gf100i5-intel-16710161
概述
熟悉该组件的基本一般信息、属性和特征，以及其与行业标准和法规的符合情况。
生命周期高级
欧盟RoHS No
RoHS版本2011/65/EU, 2015/863
类别路径
Semiconductor > Programmable Devices > Programmable Logic Devices > Complex Programmable Logic Devices - CPLDs
Semiconductor > Programmable Devices > Programmable Logic Devices > Complex Programmable Logic Devices - CPLDs
技术资料
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数据表预览
(Latest 版本)制造
制造信息指定了生产和组装该组件的技术要求和规格。这些信息对于制造商来说至关重要，以保持组件的质量和可靠性，并确保其与其他设备和组件兼容。
参数
参数信息显示了该组件的重要特性和性能指标，这有助于工程师和供应链经理比较和选择最适合其应用和需求的电子组件。
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生产线
Programmable Type
Maximum Internal Frequency
Maximum Clock to Output Delay
Number of Global Clocks
Maximum Operating Frequency
Tolerant Configuration Interface Voltage
Memory Size
Number of I/O Banks
Number of Inter Dielectric Layers
Data Gate
Minimum Storage Temperature
I/O Voltage
Maximum Storage Temperature
Copy Protection
Individual Output Enable Control
Reprogrammability Support
Maximum Operating Current
Temperature Flag
Device System Gates
Supplier Temperature Grade
Tradename
Maximum Propagation Delay Time
Clock Management
Family Name
Device Logic Cells
RAM Bits
Number of User I/Os
Speed Grade
Number of Product Terms per Macro
Number of Logic Blocks/Elements
Number of Macro Cells
Number of Flip Flops
Program Memory Type
Maximum Operating Supply Voltage
Process Technology
Minimum Operating Temperature
Maximum Operating Temperature
Minimum Operating Supply Voltage
Typical Operating Supply Voltage
Programmability
In-System Programmability
参考设计
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