QL3006-4PL84I
QuickLogic説明: | FPGA pASIC 3 Family 8.008K Gates 160 Cells 416.67MHz 0.35um Technology 3.3V 84-Pin PLCC |
導入日: | Apr 10, 2002 |
更新済み:21-NOV-2024 | |
オンライン版:https://www.datasheets.com/ja/part-details/ql3006-4pl84i-quicklogic-17406800
概要
コンポーネントの基本的な一般情報、特性、および特徴について理解してください。また、業界の基準や規制に適合しているかどうかも確認してください。
ライフサイクルプレミアム
EU RoHS No
RoHSバージョン2011/65/EU, 2015/863
カテゴリーパス
Semiconductor > Programmable Devices > Programmable Logic Devices > Field Programmable Gate Arrays - FPGAs
Semiconductor > Programmable Devices > Programmable Logic Devices > Field Programmable Gate Arrays - FPGAs
データシート
データシートをダウンロードすることで、電子部品の包括的な理解を得ることができます。このPDFドキュメントには、製品の概要、特徴、仕様、評価、ダイアグラム、応用例など、必要なすべての詳細が含まれています。
データシートのプレビュー
(Latest バージョン)製造
製造情報には、部品の製造および組み立てのための技術要件と仕様が明記されています。この情報は、製造業者が部品の品質と信頼性を維持し、他のデバイスや部品との互換性を確保するために重要です。
パラメーター
パラメトリック情報には、部品の重要な特徴や性能指標が表示されます。これにより、エンジニアやサプライチェーンマネージャーは、自身のアプリケーションやニーズに最も適した電子部品を比較・選択することができます。
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生産ライン
Maximum DSP Block Frequency
Maximum MLAB Capacity
Device PCIe Hard IP Blocks
Number of Regional Clocks
Maximum LVDS Data Rate
Maximum Differential I/O Pairs
Maximum I/O Performance
Maximum Distributed RAM Bits
Digital Control Impedance
Number of I/O Banks
Mega Multiply Accumulates per second
Tolerant Configuration Interface Voltage
Minimum Storage Temperature
Number of Inter Dielectric Layers
Maximum Storage Temperature
Shift Registers
Number of Global Clocks
Copy Protection
Typical Supply Current
Maximum Power Dissipation
Temperature Flag
In-System Programmability
Maximum Internal Frequency
Supplier Temperature Grade
Reprogrammability Support
Tradename
Device Logic Gates
Device Logic Units
I/O Voltage
Typical Power Consumption
Maximum Quiescent Current
JTAG Support
Maximum Supply Current
Family Name
Maximum Number of User I/Os
Number of Registers
RAM Bits
Device Logic Cells
Number of Look-up Table Input
Device System Gates
Ethernet MACs
Minimum Operating Supply Voltage
Number of Multipliers
Processor Blocks
Typical Operating Supply Voltage
Transceiver Blocks
Maximum Operating Supply Voltage
Transceiver Speed
Program Memory Type
Dedicated DSP
PCI Blocks
Device Number of DLLs/PLLs
Total Number of Block RAM
Maximum Propagation Delay Time
Giga Multiply Accumulates per Second
Maximum Number of SERDES Channels
Speed Grade
Differential I/O Standards Supported
Single-Ended I/O Standards Supported
External Memory Interface
Supported IP Core
Supported IP Core Manufacture
Minimum Operating Temperature
Maximum Operating Temperature
Programmability
Process Technology
